蒸着は、半導体の前工程を理解するうえで重要な用語です。この記事では、定義、仕組み、重要性、量産での具体例を分かりやすく解説します。
蒸着とは
蒸着は、真空中で材料を加熱または電子ビームで蒸発させ、その蒸気をウェハや基板へ付着させるPVD成膜法です。熱蒸着と電子ビーム蒸着が代表的です。
仕組み
真空により蒸発粒子と気体分子の衝突を減らし、材料源から基板へ直進させます。抵抗加熱は装置が簡潔で、電子ビーム加熱は高融点材料にも対応できます。
前工程で重要な理由
高純度膜を比較的低ダメージで形成でき、リフトオフとの相性が良い一方、方向性が強く高アスペクト比構造の被覆は苦手です。用途に応じてスパッタやCVDと使い分けます。
具体例・用途
研究開発、化合物半導体電極、光学膜、MEMS、リフトオフによる金属配線形成などに利用されます。
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前工程全体の中での位置づけ
蒸着は単独で完結する工程・指標ではありません。前工程では、前の処理で作られた膜や形状を受け取り、次の工程が安定して処理できる状態へつなぐ役割を持ちます。特にPVD、スパッタリング、CVD、真空、リフトオフとの関係を把握すると、異常が発生した際に原因工程を絞り込みやすくなります。
量産ラインでは、同じレシピを設定しても装置状態、材料ロット、ウェハ位置、チャンバー履歴によって結果が変化します。そのため、入力条件だけでなく処理中のセンサーデータと処理後の計測結果を結び付け、工程能力として管理することが重要です。
装置と処理フロー
実際の製造では、次のような流れで蒸着を管理します。装置名や順序は製品によって異なりますが、「準備・処理・計測・補正」という基本サイクルは共通しています。
- 準備:ウェハ状態、材料、前工程の測定値を確認し、対象ロットに適したレシピを呼び出します。
- 処理:温度、圧力、流量、電力、時間など必要な条件を制御し、装置センサーの波形を記録します。
- 計測:水晶振動子で成膜レートと膜厚を監視し、膜厚計、四探針、XRF、表面粗さ計で完成膜を評価します。多層膜では界面分析と密着試験も実施します。
- 補正:規格中心からのずれをSPCで判定し、必要に応じてAPC補正、装置保全、材料確認へつなげます。
主要な管理パラメータ
蒸着の品質を安定させるには、一つの設定値だけでなく複数条件の相互作用を見る必要があります。代表的な管理項目は次のとおりです。
- 真空度:残留酸素・水分を減らし膜純度と密着性を確保する
- 蒸発レート:膜厚均一性と組成変動を抑える
- 基板角度・回転:方向性の強い粒子を面内へ均一に供給する
- 材料源温度:スプラッシュと急激な蒸発を防ぎ安定供給する
開発段階では各パラメータを意図的に振るDOEを行い、品質への感度と許容範囲を確認します。量産移行後は設定値の固定だけでなく、実測値のドリフトと装置間差を継続監視します。
代表的な不具合と対策
不具合は一つの原因だけで発生するとは限りません。ウェハ面内分布、発生ロット、装置、時系列、パターン位置を比較し、再現性のある切り分けを行います。
- シャドーイングで段差側壁が薄くなるため、基板回転や傾斜、別成膜法を検討します。
- 電子ビームのスプラッシュは粒子欠陥になるため、出力立ち上げと材料表面状態を管理します。
- 密着不良は表面汚染や自然酸化膜が原因となるため、前洗浄と真空中前処理を行います。
対策後は良品条件へ戻ったことだけでなく、別の品質指標を悪化させていないか確認します。変更点をレシピ履歴とトレーサビリティへ残し、同じ異常の再発防止に利用します。
評価・計測方法
水晶振動子で成膜レートと膜厚を監視し、膜厚計、四探針、XRF、表面粗さ計で完成膜を評価します。多層膜では界面分析と密着試験も実施します。
計測値には工程そのもののばらつきと測定器のばらつきが含まれます。基準試料による校正、測定システム解析、装置間マッチングを実施し、検出した変化が実際のプロセス変動かを判断します。
技術動向
量産ロジックではスパッタやCVDが主流ですが、化合物半導体、光デバイス、MEMSでは蒸着の低ダメージ性とリフトオフ適性が重要です。自動材料交換と面内均一化が進んでいます。
微細化が進むほど、個別装置だけの最適化では十分ではありません。設計データ、装置ログ、インライン計測、電気特性、歩留まりを横断して解析し、前後工程を含む統合プロセスとして最適化する考え方が重要になっています。
実務で押さえておきたいポイント
- 用語の定義だけでなく、入力条件と出力品質の因果関係を理解する
- 平均値に加えてウェハ面内分布、ロット間差、装置間差を見る
- 異常時は直前工程、対象装置、材料ロット、計測器の順に事実を整理する
- 前工程・ウェハプロセスの用語一覧から関連技術を確認し、工程全体で判断する
よくある質問
蒸着は前工程のどこで使われますか?
研究開発、化合物半導体電極、光学膜、MEMS、リフトオフによる金属配線形成などに利用されます。
蒸着を管理する理由は何ですか?
高純度膜を比較的低ダメージで形成でき、リフトオフとの相性が良い一方、方向性が強く高アスペクト比構造の被覆は苦手です。用途に応じてスパッタやCVDと使い分けます。
まとめ
蒸着は、半導体の性能・歩留まり・生産性を支える前工程の重要技術です。単独で覚えるのではなく、関連する露光・成膜・エッチング・洗浄・配線工程とのつながりを押さえることが重要です。
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